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Logic
Designer

시스템반도체 설계와 검증을 공부하고 있는 엔지니어 채민석입니다.

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About Me

채민석
Name채민석
Emailcms2789@gmail.com
Birth date00. 09. 18
LanguageTOEIC Speaking IH
Location서울특별시
Education상명대학교
시스템반도체공학과

Projects

2025.01.05. - 2025.01.22.
FPGA / Python / Embedded
FPGA / STM32

SoC기반 펜 플로터를 이용한 커스텀 각인 서비스

펜 플로터 하드웨어 설계 및 FPGA 이미지 처리, Python 최적화, STM32 모터 제어 구현

SystemVerilog STM32 Python
2025.12.15. - 2025.12.22.
LineBuffer
UVM Verification

Linebuffer UVM Verification

Line Buffer 유닛에 대한 Frame Size 및 Data Mode별 UVM 검증 환경 구축

SystemVerilog UVM
2025.11.24. - 2025.12.04.
VGA Project
FPGA / Display Control

VGA 기반 뱀 사다리 게임 시스템 설계

FPGA 기반 VGA 타이밍 컨트롤러 및 게임 상태 엔진 구현

SystemVerilog OV7670
2025.11.07. - 2025.11.18.
SPI I2C
IP Design / Verification

SPI & I2C 통신 설계 프로젝트

센서 인터페이스를 위한 고속 직렬 통신 프로토콜 설계 및 검증

SystemVerilog AXI4-Lite SPI / I2C VCS / Verdi
2025.10.17. - 2025.10.27.
AMBA APB
SoC / Bus Protocol

AMBA APB Peripheral

SoC 저속 주변장치 제어를 위한 AMBA APB 프로토콜 기반 IP 통합 설계

SystemVerilog RISC-V(RV32I) AMBA APB
2025.09.17. - 2025.10.02.
RISC-V CPU
Computer Architecture

RISC-V Single Cycle CPU

RISC-V RV32I ISA 기반의 단일 사이클 프로세서 설계 및 정합성 검증

Verilog HDL SystemVerilog RISC-V(RV32I)
2025.08.20. - 2025.08.28.
Watch Sensor
FPGA System

FPGA UART Multi-Sensor

FPGA 기반 UART 명령 제어 및 다중 센서 데이터 통합 시스템 구축

Verilog HDL SR04 / DHT11 UART

Skills

Languages

Main Skills
Verilog HDL SystemVerilog C / C++ Python
Experience
HTML Matlab

Platforms & Development

Main Skills
Xilinx Vivado Vitis Linux STM32 CubeIDE
Experience
Synopsys VCS Verdi Intel Quartus ModelSim

Awards

2026. 01.

대한상공회의소 서울기술교육센터 프로젝트 경진대회

SoC 기반 팬 플로터를 이용한 커스텀 각인 서비스

  최우수상
2024. 06.

제15회 대한전기학회 대학생작품경진대회

시각장애인들을 위한 점자 인식 및 음성 출력 프로그램

  금상
2023. 11.

제14회 대한전기학회 대학생작품경진대회

MLP를 이용한 FinFET22nm I-V Curve 측정

  동상

Careers

2025.07. - 2026.01.

[Harman] 세미콘아카데미 설계/검증 과정 이수

VerilogHDL/UVM, ARM Cortex-M, AMBA BUS, SoC 설계 실무 교육 이수(950H)

2019.03. - 2025.08.

상명대학교 시스템반도체공학과 졸업

2016.03. - 2019.02.

단국대학교사범대학부속고등학교 졸업

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전체 프로젝트의 상세 내용이 담긴 포트폴리오 문서입니다.

[포트폴리오] 채민석_포트폴리오.pdf

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